原型验证调适技术介绍
2021-09-23

原型验证调适技术介绍

本次研讨会介绍各种常用于原型验证平台上之调适技术,涵盖了从基本 IO, bus transaction, 到 protocol system level 各种层级,让原型验证使用者,能了解这些技术,将平台的功能做更有效的发挥。



演讲主题:

原型验证调适技术介绍


演讲人:

杨一峰(Jeff)

国微思尔芯,资深应用工程师

杨一峰是国微思尔芯资深应用工程师,拥有17年半导体行业从业经验。曾就职于各大著名半导体公司,其中包括华为海思、美国莱迪思。杨一峰毕业于复旦大学,拥有电子工程专业学士学位。

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您在设计什么类型的芯片?
设计中含的ASIC门容量为?
500万 - 2千万
2千万 - 5千万
5千万 - 1亿
1亿 - 10亿
大于10亿
您倾向于使用哪款FPGA?
赛灵思 VU440
赛灵思 KU115
赛灵思 VU19P
赛灵思 VU13P
赛灵思 VU9P
英特尔 S10-10M
英特尔 S10-2800
不太确定,需要专业建议
您需要什么样的FPGA配置?
单颗FPGA
双颗FPGA
四颗FPGA
八颗FPGA
不太确定,需要专业建议
您需要什么样的外设接口?
您需要多少数量的原型验证平台?
您是否需要以下工具?
分割工具
多FPGA调试工具
协同建模工具(允许大量数据在 FPGA 与 PC 主机之间进行交互)
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大于12个月
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