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显著缩短芯片设计验证周期

Genesis 芯神匠® 架构设计软件

芯神匠架构设计软件提供了一个建模,分析,仿真和软硬件协作的平台,利用建模方法学实现电子系统级(Electronic System Level,ESL)设计流程,可用于开发半导体、航空和汽车电子系统设计产品。亦可帮助加速车规级MCU芯片架构设计,在设计之初实现周密的架构探索。通过该方案创建周期精度的模型,以便进行早期性能和功耗分析,也可进行时序和功耗的仿真,还能搭配芯神瞳原型验证平台提前进行软硬件协同设计。

    「 芯神匠 」 架构设计软件主要特点:

    • 一站式平台,完成架构设计、设计验证,实现最大化模型复用率

    • 多抽象层次建模仿真,进行 IP、SoC、系统效能与功耗优化

    • 含大量建模组件和 150 多种模块,帮助开发完整自定义组件/子系统

    • 搭配芯神瞳原型验证平台,利用既有 IP 快速精准的建模仿真



    电子系统级(ESL)架构设计流程

    电子系统级(ESL)架构设计流程


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您在设计什么类型的芯片?
设计中含的ASIC门容量为?
500万 - 2千万
2千万 - 5千万
5千万 - 1亿
1亿 - 10亿
大于10亿
您倾向于使用哪款FPGA?
赛灵思 VU440
赛灵思 KU115
赛灵思 VU19P
赛灵思 VU13P
赛灵思 VU9P
英特尔 S10-10M
英特尔 S10-2800
不太确定,需要专业建议
您需要什么样的FPGA配置?
单颗FPGA
双颗FPGA
四颗FPGA
八颗FPGA
不太确定,需要专业建议
您需要什么样的外设接口?
您需要多少数量的原型验证平台?
您是否需要以下工具?
分割工具
多FPGA调试工具
协同建模工具(允许大量数据在 FPGA 与 PC 主机之间进行交互)
您什么时间内需要使用到我们产品?
0-6个月
6-12个月
大于12个月
不太确定
其他
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