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对于Logic System板上提供的差分时钟信号，终端阻抗应当如何设置？

Logic System上的差分时钟信号，所需要的终端阻抗是不同的。可以通过查询Logic System的Manual，确定各个差分对的终端阻抗需求。并将相关约束添加在FPGA的设计约束文件中。如用户设计中终端匹配电阻设置不正确，将因为板上提供的差分时钟在用户设计中信号质量无法保证，导致设计功能不正确或不稳定。



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