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内存模型（Memory Model）

在FPGA原型验证中，为验证DDR5、LPDDR5及HBM2E/3等存储控制器，我们利用Memory Model IP，通过FPGA本身支持的DDR4来模拟这些FPGA无法直接支持的存储器。同时，为了协助系统调试，思尔芯团队为存储器模型增加了一个具备可控性与可观测性的后门，以方便进行高效的读写存储。


内存模型原理


  • DDR5, LPDDR5, DDR4, LPDDR4/4X  

  • HBM3, HBM2/2e  

  • DDR4, LPDDR4, DDR3, LPDDR3   (DFI PHY)


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