国微思尔芯推出 VU19P 原型验证系统,加速十亿门级芯片设计
2020-10-21

新分割引擎显著提升性能和效率

    • 模块化、可扩展的单、双、四核 VU19P 原型系统,单系统支持高达 1 亿 9600 万门 ASIC 设计

    • 增强的分割引擎,加速超大规模设计验证,提升设计性能

    • 完整的原型验证解决方案包括多 FPGA 深度调试,系统级协同建模及 90 多种应用接口子板库

    2020 年 10 月 22 日,国微思尔芯,一站式 EDA 验证解决方案专家,正式推出面向超大规模 SoC 原型市场的 ProdigyTM S7-19P 原型验证系统。 S7-19P 提供单、双、四核 Xilinx UltraScale+ VU19P FPGA 配置,搭配同时发布的 Player Pro 编译软件可以轻松满足如 5G、数据中心、AI/ML 和自动驾驶等大规模 SoC 设计中不断增加的复杂性和性能等验证需求。

    Virtex UltraScale+ VU19P 是赛灵思密度最高的 FPGA,是 ASIC 和 SOC 原型验证的最佳选择。采用台积电 16nm 制程的 VU19P,设计规模比上一代广受欢迎的 20nm 制程 Virtex UltraScale 440 大 1.6 倍,速度快 30%。四核 Prodigy S7-19PQ 提供:

    • 高达 196M 等效 ASIC 门的逻辑规模
    • 5,288 高性能 I/Os 用于外设扩展和多系统互连
    • 176 路高速收发器,运行速率高达 16Gbps
    • 8 个板载 DDR4 SO-DIMM 卡插槽,每个支持最高 72 位 16GB 的 DDR4

    自动化的设计分割软件和高密度原型验证硬件在验证超大模型设计时是密不可分。国微思尔芯发布新版本 Player Pro 编译软件强化以下功能:

    • 更快的分割引擎支持十亿门等级设计
    • 增强 Pin-Multiplexing 模块使系统性能提高 50%
    • 灵活支持多 Pin-Multiplexing 比率
    • 通过优化的 Black-Box 技术节省多达 70% 的时间
    • 全自动 TCL 脚本支持

    多套 Prodigy S7-VU19P 逻辑系统可轻松地互连,配上 Player Pro 软件增强的设计分割功能,可提供高效的原型验证解决方案,以实现更大容量的设计。连同 Prodigy 的其他工具如 Prodigy MDM 和 Prodigy ProtoBridge 等,均能无缝对接,提供强大深度调试、协同建模以及实时管理与控制能力。

    国微思尔芯首席执行官林俊雄表示:“我们一直在与客户密切合作以提供满足其未来原型验证需求的解决方案。通过持续的投资和技术创新,不断为我们的客户带来更高效率和更具价值的产品。我很高兴 Prodigy S7-19P 原型系统和 Player Pro 软件的面世,期待来自国微思尔芯更多令人瞩目的新品发布,帮助软件开发与系统验证人员提高生产力,加速产品上市。”

    Prodigy S7-VU19P

    媒体联系人

    Amy Gong
    MARCOM Manager
    Email: marketing@s2ceda.com

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您在设计什么类型的芯片?
设计中含的ASIC门容量为?
500万 - 2千万
2千万 - 5千万
5千万 - 1亿
1亿 - 10亿
大于10亿
您倾向于使用哪款FPGA?
赛灵思 VU440
赛灵思 KU115
赛灵思 VU19P
赛灵思 VU13P
赛灵思 VU9P
英特尔 S10-10M
英特尔 S10-2800
不太确定,需要专业建议
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